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非"均衡布线"对VLSI可靠性的影响 预览
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作者 马群刚 李跃进 杨银堂 《微电子学》 CAS CSCD 北大核心 2002年第6期 431-434,共4页
在VLSI的制造过程中,常常由于设计中布线的不均衡,导致芯片性能不稳定或者失效.文章根据一些工艺生产线上的实践,提出了"均衡布线"的概念,并且在集成电路设计、工艺等方面,提出了在非"均衡布线"时影响电路可靠性的... 在VLSI的制造过程中,常常由于设计中布线的不均衡,导致芯片性能不稳定或者失效.文章根据一些工艺生产线上的实践,提出了"均衡布线"的概念,并且在集成电路设计、工艺等方面,提出了在非"均衡布线"时影响电路可靠性的一些主要因素(负载效应、应力迁移、电迁移、串扰等)及相应的解决措施. 展开更多
关键词 VLSI 可靠性 均衡布线 负载效应 应力迁移 电迁移
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基于拥塞预测的NoC自适应仲裁方法 预览 被引量:1
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作者 杨盛光 李丽 +3 位作者 徐懿 张宇昂 娄孝祥 高明伦 《计算机应用研究》 CSCD 北大核心 2009年第2期,共4页
传统用于总线系统或互联网的仲裁方法已不能很好地适应NoC应用环境。围绕NoC系统性能的关键影响因素——拥塞状态,提出了一种基于全局和本地拥塞预测的仲裁策略(GLCA),以改善NoC网络延迟。实验结果表明,相对于RR方法,新仲裁算法使得网... 传统用于总线系统或互联网的仲裁方法已不能很好地适应NoC应用环境。围绕NoC系统性能的关键影响因素——拥塞状态,提出了一种基于全局和本地拥塞预测的仲裁策略(GLCA),以改善NoC网络延迟。实验结果表明,相对于RR方法,新仲裁算法使得网络平均包延迟和平均吞吐量最大分别可改善20.5%和8%,并且在不同负载条件下都保持了其优势。综合结果显示,GLCA与RR方法相比,路由器仅在组合逻辑上有少许增加(25.7%)。 展开更多
关键词 片上网络 仲裁方法 拥塞 延迟 拥塞区域
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采用启发式方法放置去耦合电容的供电网络优化算法 预览 被引量:1
3
作者 蔡懿慈 熊焰 +1 位作者 傅静静 洪先龙 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2006年第4期 513-518,共6页
提出一种有效的启发式算法,利用芯片上的空白布局空间放置去耦合电容,实现供电网络的噪声优化,同时使去耦合电容占用较小的芯片面积资源.该算法采用伴随网络方法快速计算电路灵敏度,并应用等效电路技术来提高算法效率.实验结果表... 提出一种有效的启发式算法,利用芯片上的空白布局空间放置去耦合电容,实现供电网络的噪声优化,同时使去耦合电容占用较小的芯片面积资源.该算法采用伴随网络方法快速计算电路灵敏度,并应用等效电路技术来提高算法效率.实验结果表明,文中算法取得了很好的优化效果,并具有优化大规模电源/地线网络的能力. 展开更多
关键词 VLSI 电源/地线网络 噪声优化 去耦合电容 启发式方法 供电网络
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混合技术电路板簇测试的多边界扫描链优化配置 预览 被引量:2
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作者 刘冠军 曾芷德 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2000年第10期 792-795,共4页
由边界扫描器件和非边界扫描器件组装的混合技术电路板将在今后相当长时间内广泛存在,析台由非边界扫描器件组成的簇的测试是边界扫描测试领域重要而富有实际价值的问题。为减少其测试时间,基于贪婪策略和单扫描链最优排序技术,提出... 由边界扫描器件和非边界扫描器件组装的混合技术电路板将在今后相当长时间内广泛存在,析台由非边界扫描器件组成的簇的测试是边界扫描测试领域重要而富有实际价值的问题。为减少其测试时间,基于贪婪策略和单扫描链最优排序技术,提出了一种多边界扫描链优化配置技术,经实例验证表明,该技术可以有效地减少混合技术电路板族测试时间,提高测试效率。 展开更多
关键词 边界扫描 簇测试 混合技术电路板 VLSI
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区间图中连续1性质的试验 预览
5
作者 钱建平 《南京理工大学学报:自然科学版》 CAS CSCD 2000年第5期 433-436,共4页
在VLSI设计中,栅极矩阵法需用到区间图,区间图具有连续1的性质,该文提出区间图中连续1性质试验的一种处,它从AA开始,建立在行向量的内积关系上,逐步确定行的次序,最终判断出连续1的性质,它同Fulerson算法相比,适应性和实用性... 在VLSI设计中,栅极矩阵法需用到区间图,区间图具有连续1的性质,该文提出区间图中连续1性质试验的一种处,它从AA开始,建立在行向量的内积关系上,逐步确定行的次序,最终判断出连续1的性质,它同Fulerson算法相比,适应性和实用性更强,且简便有效。 展开更多
关键词 超大规模集成电路 矩阵 区间图 栅极矩阵法 连续1性质
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全自动光刻机自动对准与激光扫描光学系统 预览
6
作者 吴长发 《华中理工大学学报》 CSCD 北大核心 1991年第5期 27-32,共6页
本文首先概述了全自动光刻机的对准光学系统,接着详细阐述了激光扫描实时检测对准误差的基本原理,分析了扫描对准光学系统的设计要求,讨论了设计时应该遵循的原则、设计方法、设计步骤和有关方案,并给出了部分测试结果.
关键词 光刻机 激光 扫描 光学系统 VLSI
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球形SiO2在VLSI封装材料中的应用 被引量:1
7
作者 孙卫明 周红卫 《化工新型材料》 CAS CSCD 北大核心 1991年第11期 29-31,共3页
<正> 随着对VLSI(超大规模集成电路)塑料封装性能要求的不断提高,人们正在开发球形二氧化硅以替代以往角形二氧化硅作为塑封料的填充料。日立公司成功地以球形二氧化硅为填充料开发了超低膨胀系数塑封料,实验室产品的热膨胀系数... <正> 随着对VLSI(超大规模集成电路)塑料封装性能要求的不断提高,人们正在开发球形二氧化硅以替代以往角形二氧化硅作为塑封料的填充料。日立公司成功地以球形二氧化硅为填充料开发了超低膨胀系数塑封料,实验室产品的热膨胀系数已降至0.7×10~(-5)/℃,批量生 展开更多
关键词 集成电路 VLSI 二氧化硅 塑封料
ispLSI1032E器件及其应用 预览 被引量:3
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作者 丁家峰 曹建 李新梅 《电子元件与材料》 CAS CSCD 北大核心 2002年第11期 34-36,共3页
介绍了Lattice公司的大规模集成电路ispLSI1032E,它是一种在系统复杂可编程逻辑器件(CPLD),借助于EDA设计软件可以随时更改芯片的功能,而且不需要改动印制电路板(PCB)的结构,大大提高了系统设计的效率,并保证了设计的正确性.最后设计了... 介绍了Lattice公司的大规模集成电路ispLSI1032E,它是一种在系统复杂可编程逻辑器件(CPLD),借助于EDA设计软件可以随时更改芯片的功能,而且不需要改动印制电路板(PCB)的结构,大大提高了系统设计的效率,并保证了设计的正确性.最后设计了基于该芯片的EDA教学实验系统. 展开更多
关键词 ispLSI1032E器件 Laffice公司 大规模集成电路 可编程逻辑器件
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一种新颖的集成电路版图验证方法 预览 被引量:3
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作者 汤炜 林争辉 +1 位作者 朱以南 肖世红 《微电子学》 CAS CSCD 北大核心 2003年第2期 113-117,共5页
版图验证是集成电路设计的瓶颈之一.文章全面系统地阐述了超大规模集成电路LVS版图验证的原理、方法和基本的流程,着重介绍了基于Dracula开发的CMOS、Bipolar和ABCD(Advanced Bipolar CMOS DMOS)工艺的LVS命令文件,在解决以上工艺的电路... 版图验证是集成电路设计的瓶颈之一.文章全面系统地阐述了超大规模集成电路LVS版图验证的原理、方法和基本的流程,着重介绍了基于Dracula开发的CMOS、Bipolar和ABCD(Advanced Bipolar CMOS DMOS)工艺的LVS命令文件,在解决以上工艺的电路LVS的过程中,取得了令人满意的效果. 展开更多
关键词 超大规模集成电路 版图验证 VLSI Dracula语言 LDMOS LVS工具
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GBn288—88中的硅外延工艺诱生缺陷图片说明:谈诱生缺陷对器件...
10
作者 南富生 周正鸣 《电子工业标准化通讯》 1990年第5期 21-25,共5页
关键词 诱生缺陷 硅外延工艺 器件性能 IC
一种归并排序算法的阵列映射 预览
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作者 姚远 杨卫中 《小型微型计算机系统》 CSCD 北大核心 1997年第7期 13-16,共4页
本文介绍一种归并排序算法--插入归并算法的基本原理,并通过该算法的Systolic阵列映射,重点阐述了正则映射生成VLSI阵列的理论和方法,最后,还指出了改进脉动阵列通用性和灵活性的途径。
关键词 脉动阵列 排序 归并算法 正则映射 VLSI
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高(板厚/孔径)比多层板小孔电镀工艺技术 预览 被引量:1
12
作者 黄玉文 《电镀与精饰》 CAS 1997年第6期 26-27,共2页
关键词 电镀 工艺 多层板 高比厚板 小孔径 印刷电路板
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让空闲机器总加工最紧急的批量不一定合理 预览
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作者 熊中楷 里奇曼 《系统工程学报》 CSCD 1997年第2期 94-100,共7页
超大规模集成电路制造(VLSI)是当今世界上最复杂的制造过程,缩短产品制造时间的均值和方差对于增加产量、降低成本和缩短交货期有重要的作用。文献[4]比较了半导体制造业各种调度方法的效果,指出“空闲机器加工最紧急的批量... 超大规模集成电路制造(VLSI)是当今世界上最复杂的制造过程,缩短产品制造时间的均值和方差对于增加产量、降低成本和缩短交货期有重要的作用。文献[4]比较了半导体制造业各种调度方法的效果,指出“空闲机器加工最紧急的批量是合理的”。让空闲机器总加工最紧急的比量就一定明智吗?本文分析了一些反例,并给出一个有效的算法,改善了文献[4]的部分结果。 展开更多
关键词 生产调度 批量 VLSI 制造
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Intel进一步缩小浮体存储器单元面积 预览
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《集成电路应用》 2008年第9期 31,共1页
在Honolulu举办的2008Symposium on VLSI Technology技术论坛上,Intel Corp.的研究人员发布了新一代基于绝缘硅(SOI)通过埋层氧化层(BOX)储存电荷的浮体存储器单元(FBC)。针对一些专家提出的缩小尺寸将导致器件的荷电保持能力下... 在Honolulu举办的2008Symposium on VLSI Technology技术论坛上,Intel Corp.的研究人员发布了新一代基于绝缘硅(SOI)通过埋层氧化层(BOX)储存电荷的浮体存储器单元(FBC)。针对一些专家提出的缩小尺寸将导致器件的荷电保持能力下降的疑虑, 展开更多
关键词 INTEL 单元面积 存储器 浮体 荷电保持能力 VLSI 技术论坛 研究人员
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基于FPGA的可重构软测量系统硬件设计 预览
15
作者 魏刚 韩建国 《仪器仪表用户》 2006年第4期 51-52,共2页
针对软测量系统中的硬件设计,本文介绍一种基于FPGA的可重构软测量系统.该系统通过CPLD控制FPGA配置不同的软测量模型算法的配置数据流,来完成软测量系统的可重构.该系统既具有硬件方式的并行性和速度性又具有软件方式的灵活性.
关键词 FPGA 可重构 软测量 人工神经网络 硬件设计
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中国超大规模企业呈明显的重化工业特征 预览
16
《中国石油和化工》 2005年第12期 53,共1页
国家统计局近日发布数字显示,中国超大规模企业呈明显的重化工业特征。
关键词 超大规模 特征 工业 企业 中国 国家统计局 数字显示
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宽带通信芯片中级联积分梳状插值滤波器的优化设计 预览 被引量:3
17
作者 孙晨 赵毅强 +1 位作者 刘强 李旭 《计算机工程》 CAS CSCD 北大核心 2015年第8期252-255,261共5页
级联积分梳状(CIC)滤波器由于其结构简单、高效等优点,经常作为宽带通信芯片中的抽取器或插值器。随着通信系统以及超大规模集成电路的发展,芯片集成密度越来越高,需要对芯片中关键模块积分梳状滤波器进行面积的优化。为此,设计一种... 级联积分梳状(CIC)滤波器由于其结构简单、高效等优点,经常作为宽带通信芯片中的抽取器或插值器。随着通信系统以及超大规模集成电路的发展,芯片集成密度越来越高,需要对芯片中关键模块积分梳状滤波器进行面积的优化。为此,设计一种应用于无线宽带射频芯片的CIC插值滤波器。通过位宽优化方法减少滤波器内部节点位宽,并在增益校正部分采用输出截位后的正则有符号数字量编码乘法代替全位宽二进制补码乘法。实验结果表明,与优化前的CIC插值滤波器相比,该滤波器的电路面积可优化58%左右。 展开更多
关键词 级联积分梳状插值滤波器 宽带通信芯片 位宽优化 增益校正 正则有符号数字量编码乘法 面积优化
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引入电流变化率的电源分布网络最差噪声分析算法 预览 被引量:1
18
作者 赵振宇 孙浩 +1 位作者 邓全 蒋剑锋 《国防科技大学学报》 EI CAS CSCD 北大核心 2016年第2期82-86,共5页
随着时钟频率的增加以及电源电压的降低,电源完整性问题日益凸显。将电流变化率加入到最差噪声算法的电流约束中,能够在任意电流变化率的情况下分析电源分布网络的最差噪声,从而获得更加真实的最差噪声。另外,利用改进的Knuth-Yao四边... 随着时钟频率的增加以及电源电压的降低,电源完整性问题日益凸显。将电流变化率加入到最差噪声算法的电流约束中,能够在任意电流变化率的情况下分析电源分布网络的最差噪声,从而获得更加真实的最差噪声。另外,利用改进的Knuth-Yao四边形不等式法对基于动态规划的最差噪声算法进行加速,加速后算法的时间复杂度从O(n-2m)降为O(mnlogn)。 展开更多
关键词 动态规划 最差噪声 变化率 电源分布网络 时域分析
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高吞吐率双模浮点可重构FFT处理器设计实现 预览
19
作者 魏星 黄志洪 杨海钢 《电子与信息学报》 CSCD 北大核心 2018年第12期3042-3050,共9页
高吞吐浮点可灵活重构的快速傅里叶变换(FFT)处理器可满足尖端雷达实时成像和高精度科学计算等多种应用需求。与定点FFT相比,浮点运算复杂度更高,使得浮点型FFT的运算吞吐率与其实现面积、功耗之间的矛盾问题尤为突出。鉴于此,为... 高吞吐浮点可灵活重构的快速傅里叶变换(FFT)处理器可满足尖端雷达实时成像和高精度科学计算等多种应用需求。与定点FFT相比,浮点运算复杂度更高,使得浮点型FFT的运算吞吐率与其实现面积、功耗之间的矛盾问题尤为突出。鉴于此,为降低运算复杂度,首先将大点数FFT分解成若干个小点数基2k级联子级实现,提出分别针对128/256/512/1024/2048点FFT的优化混合基算法。同时,结合所提出同时支持单通道单精度和双通道半精度两种浮点模式的新型融合加减与点乘运算单元,首次提出一款高吞吐率双模浮点可变点FFT处理器结构,并在28nm标准CMOS工艺下进行设计并实现。实验结果表明,单通道单精度和双通道半精度浮点两种模式下的运算吞吐率和输出平均信号量化噪声比分别为3478 GSample/s,135 dB和6957 GSample/s,60 dB。归一化吞吐率面积比相比于现有其他浮点FFT实现可提高约12倍。 展开更多
关键词 快速傅里叶变换 双模浮点 混合基 融合运算单元
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三维集成电路中内存的经时击穿分析与检测 预览
20
作者 贾鼎成 王磊磊 高薇 《西安电子科技大学学报》 EI CAS CSCD 北大核心 2019年第4期182-189,共8页
三维多处理器内存堆叠系统能够显著提升系统性能,但伴随而来的热密度以及散热成为影响电路可靠性的关键问题.为了研究并检测三维集成电路结构中内存的经时击穿效应,笔者采用了一种SPICE物理模型,基于蒙特卡罗仿真的方法,对栅极击穿漏电... 三维多处理器内存堆叠系统能够显著提升系统性能,但伴随而来的热密度以及散热成为影响电路可靠性的关键问题.为了研究并检测三维集成电路结构中内存的经时击穿效应,笔者采用了一种SPICE物理模型,基于蒙特卡罗仿真的方法,对栅极击穿漏电流造成的电路影响进行了分析.同时根据内存中灵敏放大器的特点,笔者提出了基于45nm工艺节点的经时击穿检测电路,适用于大规模存储电路集成;并对检测电路在偏置温度不稳定性影响下的工作情况加以分析.实验仿真结果表明,相比字线驱动电路,灵敏放大器更易受到经时击穿的影响.提出的检测电路可以实现对经时击穿的预警功能并完全覆盖灵敏放大器中由击穿诱发的激活出错问题,且对偏置温度不稳定性效应有良好的鲁棒性. 展开更多
关键词 可靠性 经时击穿 三维集成电路 动态随机存取存储器 检测
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